第1章 CMOS器件的现状
1.1 半导体器件的分类
1.2 CMOS器件的特征
1.3 CMOS产品的种类和特点
第2章 CMOS的结构
2.1 CMOS的结构
2.2 设计规则
2.3 CMOS的制造工程
2.3.1 衬底材料的制作
2.3.2 前工序
2.3.3 后工序
第3章 CMOS的基本特性与逻辑电路的基本结构
3.1 CMOS的基本特性
3.1.1 N-ch MOS FET的特性表达式
3.1.2 P-ch MOS FET的特性表达式
3.1.3 CMOS反相器的特性
3.1.4 逻辑阈值电压
3.1.5 过渡区中的输出电压
3.1.6 电阻近似
3.2 CMOS的特点
3.2.1 功率消耗小
3.2.2 能够在低电压下工作/工作电压范围宽
3.2.3 噪声余量大
3.2.4 容易集成化
3.2.5 输入阻抗高
3.2.6 基于输入电容的初次记忆
3.3 基本逻辑电路
3.4 正逻辑与负逻辑
3.5 基本电路
3.5.1 反相器
3.5.2 NAND门
3.5.3 NOR门
3.5.4 AND，OR门
3.5.5 传输门
3.5.6 时钟脉冲门
3.5.7 ExclusiveOR/NOR门
3.5.8 触发器
3.6 CMOS的保护电路
3.6.1 输入保护电路
3.6.2 输出的保护
3.6.3 电源/GND浮动时的保护
第4章 CMOS器件的种类与特征
4.1 CMOS标准逻辑
4.1.1 双极逻辑的诞生
4.1.2 CMOS逻辑的诞生
4.2 74***型的魅力
4.2.1 BiCMOS逻辑的特征
4.2.2 ECL的特征
4.2.3 ASIC的问世与标准逻辑的需要
4.2.4 单门逻辑的诞生
4.2.5 低电压化的趋势
4.2.6 封装的发展趋势
4.3 存储器
4.3.1 ROM
4.3.2 RAM
4.4 ASIC的种类与特征
4.4.1 ASIC化的潮流
4.4.2 半定制
4.4.3 PLD
4.4.4 门阵列
4.4.5 标准单元
4.4.6 全定制LSI
4.5 半定制LSI的设计方法
第5章 标准逻辑IC的功能与使用方法
5.1 组合逻辑电路
5.1.1 门电路
5.1.2 门电路的应用举例
5.1.3 特殊门电路
5.1.4 开路漏极
5.1.5 模拟开关
5.1.6 总线缓冲器
5.1.7 双向总线缓冲器
5.1.8 总线缓冲器与总线的连接
5.1.9 多路转换器/逆多路转换器/选择器
5.1.10 在多变数1输出逻辑电路中的应用
5.1.11 译码器/编码器
5.1.12 使用译码器的CPU周边LSI的选择
5.2 时序逻辑电路
5.2.1 锁存器
5.2.2 锁存器的应用举例
5.2.3 总线数据的暂存记忆
5.3 触发器
5.3.1 触发器的动作
5.3.2 触发器的应用举例
5.3.3 总线的数据分配和保持电路
5.3.4 计数器
5.3.5 计数器的串级连接举例
5.3.6 移位寄存器
5.3.7 移位寄存器的应用举例
5.3.8 单稳多谐振荡器
5.3.9 单稳多谐振荡器的应用举例
第6章 CMOS逻辑IC的特性
6.1 CMOS器件的接口
6.2 CMOS器件的标准接口
6.2.1 CMOS的输入输出特性
6.2.2 CMOS电平与TFL电平
6.2.3 CMOS电平的趋势
6.3 接口的专门技术
6.3.1 扇出端数
6.3.2 三态输出与输出冲突
6.3.3 上/中/下冲，反射，激振噪声
6.3.4 线连“或”电路与从低电压向高电压的电平变换
6.4 电压变换接口
6.4.1 从高电压向低电压变换的接口
6.4.2 输出的容忍功能
6.4.3 从低电压向高电压变换的接口
6.4.4 高→低/低→高双向电压变换接口
6.5 冒险
6.5.1 冒险引起的故障
6.5.2 晶体管与CMOS逻辑的接口
6.5.3 高速接口(单端与差动传送)概要
6.5.4 单端
6.5.5 差动传送(异动)
第7章 CMOS器件的失效模式
7.1 器件自身的失效
7.1.1 早期失效
7.1.2 偶然失效
7.1.3 耗损失效
7.2 失效模式
7.3 外来因素引起的失效
7.3.1 ESD岜成的损伤
7.3.2 闩锁造成的损伤
第8章 器件模拟与传输模拟
8.1 SPICE与IBIS
8.1.1 SPICE
8.12 IBIS
8.1.3 IMIC
8.2 LSI设计流程
8.3 基于SPICE的器件/电路模拟
8.3.1 器件模拟
8.3.2 电路模拟
8.3.3 SPICE模拟器的功能
8.4 传输模拟
8.4.1 数字信号的误解
8.4.2 信号完整的基础--方波是危险的
8.4.3 传输信号的高速化技巧
8.4.4 传输线的等效电路
8.4.5 基于IBIS传输模拟
8.4.6 EMI的法规
参考文献
